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clock divider bypass enable bit

网络释义

  时钟分频器旁路使能位

位10 BYPASS：时钟分频器旁路使能位(Clock divider bypass enable bit) 0：关闭旁路：驱动SDIO_CK 输出信号之前，依据CLKDIV 数值对SDIOCLK 分频。 1：使能旁路：SDIOCLK 直接驱动SDIO_CK 输出信号。

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有道翻译

clock divider bypass enable bit

时钟分频旁路使能位

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