...刊文摘-论文中国 于低信噪比环境下的码延迟锁定环(Delay Lock Loops,DLL)鉴别器(超前减滞后鉴别器)和载波锁相环(Phase Lock Loops,PLL)鉴别器(二象反正切鉴别器):基于最优闭环传递函数,设计了二阶和三阶跟踪环数字环路滤波器的参数;..
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de Bellescize提出了一个其相位与载波相位锁住的本机振荡器来解决这个问题,也就是锁相环路 (PhaSe Lock Loop),简称PLL。锁相环是一个能够跟踪输入信号相位的闭环自动控制系统。
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RF Phase-lock Loop 射频锁相环
Phase-lock loop 锁相环 ; 回路 ; [电子] 锁相环路 ; 以及锁相回路
optical phase lock-loop 光锁相环路
Digital Phase Lock Loop 数字锁相环
system phase lock loop 系统锁相环
All Digital Phase Lock Loop 全数位锁相回路
The circuits used are Chua’circuit and phase lock loop.
所用的电路为蔡氏电路和锁相环电路。
参考来源 - 混沌电路同步的研究·2,447,543篇论文数据,部分数据来源于NoteExpress
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